RISC-V ISA를 기반으로 하는 장치에 관심을 갖는 회사의 수가 증가하고 코어, 가속기 및 인프라 구성 요소가 상용 또는 오픈 소스 형태로 제공됨에 따라 최종 사용자는 다음과 같은 점점 더 어려운 과제에 직면하고 있습니다. 그들이 최선의 선택을 하도록 보장합니다.
각 사용자는 RISC-V 제품의 유연성과 거의 동일한 일련의 요구 사항과 우려 사항을 가지고 있을 가능성이 높으며, 기존 PPA 메트릭을 훨씬 넘어 안전 및 보안 문제 또는 품질 고려 사항으로 확장됩니다. 여기에는 아키텍처 확장 및 필요한 검증을 함께 수행할 수 있는 검증 자료의 적응성이 포함될 수 있습니다.
전통적으로 가상 프로토타입, 에뮬레이션, FPGA 프로토타입(이들 사이의 하이브리드 포함) 등 세 가지 수준의 프로토타이핑이 배포되었습니다. 그런 다음 각 플랫폼은 소프트웨어 검증, 아키텍처 검증, 하드웨어 기능 검증, 성능 분석 등 다양한 목적으로 사용됩니다.
RISC-V를 위한 설계 및 소프트웨어 에코시스템이 구축되는 동안 구성 및 검증 에코시스템은 뒤처져 새로운 기술을 구축해야 합니다. 고정 프로세서의 검증에 필요한 것 이상으로 검증에 큰 어려움을 일으키는 것은 바로 RISC-V의 유연성입니다. 또한 하드웨어-소프트웨어 공동 개발이 가능할 뿐만 아니라 필요합니다.
공동 개발
과거에는 하드웨어를 선택한 다음 소프트웨어를 개발하여 실행했습니다. RISC-V에서 하드웨어는 종종 소프트웨어에 의해 구동됩니다. “가장 먼저 선택해야 할 것은 원하는 표준 RISC-V 옵션입니다. Imperas 소프트웨어. “RISC-V 기능 세트에는 현재 200개 또는 300개의 옵션이 있습니다. 알고리즘이 부동 소수점 단위, SIMD, 하드웨어 곱셈기 또는 벡터 엔진으로부터 이점을 얻을 수 있는지 어떻게 알 수 있습니까? 해당 프로세서가 수행하기를 원하는 응용 프로그램 또는 작업 유형에 대해 필요하고 감당할 수 있는 하드웨어 기능을 파악해야 합니다. 그 자체가 약간의 도전이 됩니다.”
이러한 종류의 절충안을 만들기 위해서는 프로토타입이 필요합니다. "디자이너의 목표가 성능을 평가하고 목적에 맞는 것이라면 가상 프로토타이핑이 유일하게 실행 가능한 선택입니다."라고 CMO인 Steve Roddy는 말합니다. 쿼드 릭. “하드웨어 프로토타입을 구축하는 것은 하위 시스템 또는 전체 SoC의 SystemC 모델을 생성하는 것보다 10~50배 이상 시간이 걸립니다. SystemC 가상 프로토타입은 일반적으로 이 프로세서 코어로 얻을 수 있는 초당 프레임 수 또는 허용 가능한 정확도 범위 내에서 함수 X의 최대 및 평균 대역폭 요구 사항과 같은 성능 질문에 답할 수 있을 만큼 충분히 빠르게 실행됩니다.”
올바른 정확도를 얻는 것은 어려울 수 있습니다. 솔루션 및 비즈니스 개발 담당 부사장인 Frank Schirrmeister는 "정확성과 모델을 매우 빠르게 회전시키는 능력이 관건입니다."라고 말합니다. 아르테리스 IP. “올바른 정확성은 질문이 요구하는 것이 무엇이든 정의되며, 이를 생성하는 것은 사소한 일이 아닙니다. 귀하가 ASIP 제공업체인 경우 보유하고 있는 모든 템플릿에서 해당 템플릿을 생성할 수 있습니다. 질문에 따라 파이프라인 정확도가 필요할 수도 있고 메모리 정확도가 필요할 수도 있고 완전히 정확할 필요는 없지만 CAD 부서가 관련된 경우 잘못된 질문에 대답하는 것을 너무 두려워합니다.”
그러나 정확도는 속도와 절충됩니다. Imperas의 Davidmann은 "일부 가상 프로토타입은 주기가 정확하지만 필요한 소프트웨어 처리량을 확보하기에는 너무 느리게 실행되는 경우가 많습니다."라고 말합니다. “최고 성능의 가상 프로토타입은 프로세서 파이프라인을 모델링하지 않기 때문에 성능 엔진이 아닙니다. 그들은 그것을 컴파일하고 하드웨어에서 실행할 수 있는 소프트웨어 관점에서 그것을 보고 명령어 수 또는 대략적인 타이밍 예측을 보고 대략적인 성능을 볼 수 있습니다. 이것은 이런 종류의 건축적 결정을 내리기에 충분할 것입니다.”
종종 여러 프로토타입이 필요합니다. "우리는 일반적으로 두 가지 이유로 프로토타입을 제작합니다. “하나는 모든 성능 메트릭과 요구 사항 및 기능 검증을 충족하는지 확인하기 위한 아키텍처 검증을 위한 것입니다. 다른 이유는 임베디드 소프트웨어 및 펌웨어 개발 때문입니다. 우리는 다양한 수준의 프로토타이핑 기술을 사용하며 가장 일반적인 것은 자체 FPGA를 사용하여 아키텍처 및 기능 검증을 위한 에뮬레이션 플랫폼을 개발하는 것입니다. 또한 QEMU와 같은 아키텍처 모델을 사용하여 성능 검증과 임베디드 소프트웨어 개발을 위한 가상 플랫폼을 구축합니다.”
가능성의 수가 증가하고 있습니다. RISC-V International의 CTO인 Mark Himelstein은 “오늘날 회사에서 RISC-V로 프로토타이핑하는 방법은 다양합니다. “메이커 수준의 단일 보드 컴퓨터에서 기업용 LINUX 가능 보드에 이르기까지 다양합니다. 에뮬레이션 환경(QEMU와 같은)을 통해 개발자는 하드웨어가 완성되기 전에 소프트웨어를 진행할 수 있으며 임베디드 SoC(Espressif 및 Telink와 같은 회사), FPGA(Microsemi와 같은 회사), 곧 출시될 Intel 및 SiFive의 Horse Creek 보드입니다.”
성능/정확도 트레이드오프로 돌아갑니다. "물리적 프로토타입은 실제 RTL을 연결하고 합성하기 때문에 훨씬 더 많은 설계 노력이 필요하지만 훨씬 더 높은 정확도와 처리량을 제공합니다."라고 Quadric의 Roddy는 말합니다. “국내에서 개발했든 대형 EDA 회사에서 제작했든 FPGA 시스템의 물리적 프로토타입을 가져오려면 노력이 필요합니다. 그러나 SystemC 모델보다 훨씬 빠르게 실행하고 전체 게이트 레벨 시뮬레이션보다 몇 배 더 빠르게 실행할 수 있습니다. 설계 팀은 일반적으로 IP 선택 프로세스 동안 C 기반 모델에서 IP 선택 후 실제 설계 검증을 위한 물리적 모델과 시스템 소프트웨어 개발 플랫폼으로 전환합니다.”
하드웨어에서 원하는 기능 세트를 알게 되면 대부분의 요구 사항을 충족하는 솔루션을 이미 만든 사람이 있는지 확인할 수 있습니다. Davidmann은 "모든 공급업체가 있기 때문에 원하는 유형의 제품을 제공할 수 있는 상용 솔루션이 있을 가능성이 있습니다."라고 말합니다. “하지만 RISC-V를 사용하면 해당 솔루션을 있는 그대로 받아들일 필요가 없습니다. RISC-V의 가치 중 상당 부분은 변경, 수정 및 원하는 다양한 항목을 추가할 수 있는 자유입니다.”
구현 선택
파이프라인 단계의 수 또는 예측 실행 기능과 같은 일련의 기능을 구현하는 방법에는 여러 가지가 있습니다. 각각은 전력, 성능 및 영역 간에 서로 다른 절충안을 갖습니다. Roddy는 “RISC-V, Arm, Cadence의 Xtensa, Synopsys의 ARC 등 ISA의 특징은 모델링 및 프로토타이핑 목표와 장단점에 실제로 영향을 미치지 않습니다. “시스템 설계자는 프로세서 브랜드에 관계없이 SoC 설계 목표에 대한 질문에 답해야 합니다. 기술 수준에서 RISC-V 시류는 모델링 및 성능 분석 도구 지원과 관련하여 시장에서 실제로 안정적인 위치에 있습니다. 서로 다른 구현 및 프로세서 기능을 갖춘 수많은 경쟁 핵심 공급업체가 있습니다. 메인 시스템 CPU로서 Arm의 수명이 없으므로 EDA 세계의 에코시스템 플레이어는 소수이며 다양한 기성품 RISC-V 코어에 대해 광범위하게 검증되고 즉시 사용할 수 있는 모델링 지원을 제공합니다. RISC-V 공급업체. 구성 가능하고 수정 가능한 코어인 RISC-V 세계는 Tensilica가 25년 동안 구축한 명령 세트 자동화 수준에서 뒤쳐져 있습니다. 따라서 RISC-V는 기성 구성 요소로서 모델링 지원이 적고 명령어 세트 실험을 위한 플랫폼으로 사용할 자동화가 적습니다.”
그러나 이는 평가가 필요한 구현의 한 측면일 뿐입니다. 그것의 품질은 무엇입니까? 수정하려는 경우 어떻게 다시 유효성을 검사합니까?
성능은 이들 중 평가하기 가장 쉽습니다. Davidmann은 "이것은 기존의 프로세서 공급업체에 가는 것과 다르지 않습니다."라고 말합니다. “그들은 이 코어가 와트당 이렇게 많은 Dhrystones를 제공한다고 말할 것입니다. 일반적인 프로세서 분석 데이터를 제공할 것입니다. 이는 이 마이크로 아키텍처가 얼마나 빨리 실행되는지를 나타냅니다. 그들은 모든 데이터를 가지고 있으며 프로세서 코어를 라이선스하는 사람은 누구나 해당 데이터에 익숙할 것이며 그들과 대화하고 해당 정보를 얻을 것입니다. 아마도 데이터 시트에 선택할 수 있는 옵션이 많을 것이고 '이 옵션을 켜면 이것저것 얻을 수 있습니다.'라고 말할 것입니다. 공급업체 웹사이트의 데이터 시트에서 확인할 수 있습니다.”
이 수준에서는 주기 정확도가 필요할 수 있습니다. Schirrmeister는 "대부분의 사람들이 에뮬레이터에 펌핑하고 합리적인 결정을 내리기 위해 충분한 데이터를 실행하는 것을 봅니다."라고 말합니다. “가상 프로토타입으로의 이동이 곧 이루어질 것 같지는 않습니다. 일부 회사에서는 고유한 단일 보드 솔루션이 있는 FPGA 프로토타입에 대해 이야기하고 있습니다. 대답해야 하는 질문에 따라 이를 구성하고 생성한 다음 FPGA로 펌핑하여 적절한 소프트웨어 루틴을 통해 더 많은 데이터를 실행하도록 결정할 수 있습니다. 업계는 이를 가능하게 하는 에뮬레이터 및 프로토타이핑에 대한 충분히 빠른 진입 방법을 가지고 있습니다. 기본적인 문제는 가능한 한 정확한 데이터를 기반으로 결정을 내리기를 원하지만 그 결정을 내리려는 시점에 정확한 데이터가 없을 수 있다는 것입니다.”
이러한 프로토타입의 대부분은 프로세서 이상을 포함해야 합니다. "가상 플랫폼은 실제 환경에서 작동하는 메모리 및 센서와 같은 다른 외부 물리적 하드웨어 기능과 통합할 수 있는 기능을 제공합니다."라고 Microchip의 Narayanan은 말합니다. “하이브리드 시스템은 다른 외부 기능을 위한 물리적 프로토타입과 가상 플랫폼을 결합할 수 있습니다. FPGA 에뮬레이션 및 프로토타이핑은 경합 조건과 같은 타이밍 관련 버그를 찾는 데 도움이 됩니다. 이는 주기가 더 정확하고 외부 기능이 빠르게 실행되기 때문입니다.”
확인
프로세서 설계가 오랫동안 사내에서 이루어졌기 때문에 프로세서 구축을 위한 공개 검증 에코시스템이 없으며 RISC-V의 기능에는 과거에 존재했던 것보다 훨씬 더 유연한 검증 솔루션이 필요합니다. 이것의 창조는 이제 막 일어나기 시작했습니다.
"Dhrystones 또는 CoreMark와 같은 업계 지표가 있으므로 사람들이 성능을 비교할 수 있습니다."라고 Davidmann은 말합니다. “하지만 검증 품질을 어떻게 비교할 수 있습니까? 각 벤더가 '우리는 이렇게 한다'고 말할 수 있도록 공평한 경쟁의 장이 필요합니다. 확인과 관련된 몇 가지 품질 지표가 필요합니다.”
이것은 오픈 소스 운동이 도움이 될 수 있는 곳입니다. Schirrmeister는 “RISC-V 에코시스템을 보면 경험이 많은 프로세서 개발자가 많이 있습니다. “두 가지 극단이 있습니다. 하나는 벤더로부터 코어를 받고 있는데 작동하지 않으면 문제가 있는 것입니다. 반면에 나는 완전한 자유를 누리고 모든 것을 스스로 합니다. 이 두 극단 사이 어딘가에서 균형이 형성되고 있습니다. 벤더가 일정량의 검증을 제공하고 확장은 자신의 책임입니다.”
여기에서 지표가 필요합니다. "ISA 호환성은 소수의 회사만이 올라간 복잡성으로 가득 찬 사다리의 첫 번째 단계에 불과합니다."라고 Breker Verification Systems의 CEO인 Dave Kelf는 말합니다. “프로토타입 제작은 안정적인 프로세서 작동을 완전히 보장할 수 있는 유일한 방법일 수 있지만 실제 워크로드를 활용하여 이러한 프로토타입을 구동하는 것은 실제 프로세서 범위의 표면을 긁는 것입니다. 이는 개발 가속화 및 시장 출시 시간 문제를 주도하는 개방형 ISA의 경쟁적 노력과 상충됩니다.”
그러나 그 지표는 무엇입니까? "OpenHW 품질 그룹에서 우리는 이러한 메트릭이 무엇이어야 하는지 알아내려고 노력하고 있습니다."라고 Davidmann은 말합니다. “단순한 지침이 아니기 때문에 여기에는 기능적 보장과 같은 것이 포함됩니다. 고품질 프로세서를 위해서는 그 이상이 필요합니다. 참조에 대한 비교가 모든 것을 다루고 있다는 확신이 있는 검증 방법론이 필요합니다. 기능적 커버리지는 단지 당신이 테스트를 받았음을 보여주지만, 그것은 어떤 형태의 알려진 레퍼런스와 비교하는 방법론과 결합되어야 합니다. 테스트 벤치가 실제로 문제를 감지하는지 확인할 수 있도록 결함 주입 기술을 추가할 예정입니다.”
그림 1: RISC-V 검증 솔루션의 아키텍처 정의. 출처: 임페라스
일련의 도구가 필요합니다. Axiomise의 창립자이자 CEO인 Ashish Darbari는 "RISC-V 생태계가 성숙함에 따라 상업적 구현이 정의된 시장 부문을 지원하기 시작했습니다."라고 말합니다. “우리는 기능적 안전 준수를 요구하는 자동차와 같은 시장에 대한 지원을 봅니다. 우리는 보안이 필요한 IoT에 대한 지원을 봅니다. RISC-V 공급업체는 아키텍처 모델링 및 성능을 위한 가상 프로토타이핑을 비롯한 고급 검증 기술에 투자하고 있습니다. 이제 설계 프로세스 초기에 버그를 제거하고 설계자가 프로세서 메모리 인터페이스에서 시뮬레이션을 통해 코너 케이스 버그를 포착하는 데 어려움을 겪을 때 버그 삽입을 방지하기 위한 공식적인 방법을 조기에 채택할 수 있는 도구를 사용할 수 있습니다.”
필요한 도구 중 하나는 기능 목록 또는 기능 세트를 기반으로 테스트 사례를 생성하는 기능입니다. Breker's Kelf는 “검증 복잡성을 적시에 고려하는 프로토타입을 구동하기 위한 테스트 콘텐츠의 자동화된 생성이 핵심입니다.”라고 말합니다. "이러한 생성 메커니즘이 이제 시장에 등장하기 시작했습니다."
결론
생태계는 가장 약한 구성 요소와 EDA 도구 체인인 RISC-V만큼만 좋습니다. 그 이유는 두 가지입니다. 첫째, 최근까지 프로세서 검증 도구에 대한 상업적 시장이 없었습니다. 그들은 과거에 존재했지만 모두 사라졌거나 레거시 프로세서 회사로 해체되었습니다. 둘째, RISC-V ISA의 유연성은 새로운 도구 세트를 필요로 하는 새로운 시스템 수준 최적화 접근 방식을 생성합니다. 이 기회를 이해하고 이를 적절하게 다루는 상용 도구가 나타나려면 시간이 걸립니다.
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