Lors de la récente pandémie de COVID, il était courant d’entendre parler de constructeurs automobiles incapables de livrer de nouveaux véhicules, en raison de la pénurie de puces automobiles spécifiques. Même le mauvais temps a interrompu la fourniture de pièces semi-conductrices à certains clients. Cette perturbation de la chaîne d'approvisionnement des circuits intégrés a amené de nombreuses entreprises qui achètent et utilisent des semi-conducteurs à envisager de déplacer certaines de leurs conceptions de puces vers des programmes internes. Un récent livre blanc de Methodics aborde les défis de la conception de puces en interne.
Les exemples de réussite d'entreprises de systèmes créant leurs propres conceptions de puces incluent Apple, Tesla, NVIDIA, Qualcomm et Broadcom. La conception de circuits intégrés avec leurs logiciels embarqués nécessite de l'expérience et des bonnes pratiques. De nombreux composants des circuits intégrés sont des éléments constitutifs appelés IP, et il existe tout un écosystème parmi lequel choisir parmi des fonctions communes prédéfinies, telles que : radios (Bluetooth, WiFi), RAM, ROM, processeurs, USB, etc.
La conception de semi-conducteurs comporte également des risques et des coûts élevés dus au logiciel EDA pour la conception et aux photomasques impliqués dans la fabrication. Il est nécessaire de calculer le retour sur investissement dès le début d'un projet IC, et l'utilisation d'une approche basée sur IP est une bonne pratique. La modélisation de votre nouveau CI sous forme de blocs IP permet à votre groupe d'ingénierie de comparer le développement en interne à l'achat de propriété intellectuelle auprès d'un tiers. La planification et le suivi de toute la propriété intellectuelle sont fondamentaux pour modéliser les coûts et suivre les progrès du développement.
La méthodologie recommandée par Methodics consiste à commencer par une nomenclature de planification (BoM) pour évaluer les compromis et effectuer une analyse. L'utilisation d'un outil de gestion du cycle de vie des produits (PLM) à usage général pour les composants semi-conducteurs tiers et d'un outil BoM de planification des semi-conducteurs pour la conception de puces en interne vous permet de comparer chaque approche. La combinaison du PLM et Gestion méthodique du cycle de vie de la propriété intellectuelle (IPLM) est présenté ci-dessous, dans le cadre du processus de décision de création ou d'achat visant à améliorer votre chaîne d'approvisionnement.
La BoM de planification contient tous les détails pour chaque IP hiérarchique utilisée, ainsi que l'historique des versions au fur et à mesure que chaque IP passe par un cycle de publication. Votre équipe passe de l'utilisation de la BoM de planification à une BoM d'exécution tout en utilisant Perforce IPLM.
La hiérarchie IP est définie dans la nomenclature d'exécution et doit prendre en charge les outils de gestion de données populaires tels que Git or Noyau d'hélice Perforce. Tout conflit de version doit être automatiquement identifié dans les adresses IP matérielles et logicielles pour maintenir la compatibilité.
Les adresses IP matérielles et logicielles sont gérées selon cette approche, garantissant que les exigences peuvent être tracées pour chaque composant. Vous saurez quel composant logiciel est livré pour chaque composant matériel, garantissant ainsi la transparence.
Les ingénieurs de publication sont chargés de suivre chaque version candidate et de gérer le processus d'intégration, et l'utilisation de Methodics IPLM automatise les processus manuels d'intégration et de conservation.
Les métadonnées peuvent être utilisées pendant le processus de conception pour tenir compte des exigences de conformité en matière de sécurité fonctionnelle ISO 26262 par IP. La traçabilité des exigences jusqu'aux blocs IP est capturée avec Methodics IPLM. Même les métadonnées de sécurité peuvent être ajoutées à la hiérarchie IP ou aux composants pour aider à évaluer les menaces de sécurité pour chaque projet, lorsque vous faites référence à une assurance de sécurité IP interne (IPSA) catalogue des enjeux d'un circuit.
Résumé
Les sociétés de systèmes adoptent progressivement des projets de conception de circuits intégrés en interne afin de réduire les goulots d'étranglement de la chaîne d'approvisionnement. L’utilisation d’une méthodologie centrée sur l’IP est une bonne pratique pour contrôler votre retour sur investissement et commencer à créer une réutilisation de l’IP. La plateforme Methodics IPLM existe depuis de nombreuses années et aide à gérer les défis de la conception basée sur IP dans des entreprises entières.
Les avantages de cette approche sont les suivants : traçabilité des exigences, gestion de la réutilisation de la propriété intellectuelle, disponibilité d'un catalogue centralisé de toute la propriété intellectuelle – matériel et logiciel, disponibilité des nomenclatures de planification et de plate-forme, et disponibilité d'analyses pour voir où vous en êtes.
Lisez les neuf pages en entier Livre blanc en ligne ici de la Méthodologie.
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