पिन-कुशल सीएक्सएल इंटरफेस के साथ सर्वर डिजाइन (जॉर्जिया टेक)

जॉर्जिया टेक के शोधकर्ताओं द्वारा "ए केस फॉर सीएक्सएल-सेंट्रिक सर्वर प्रोसेसर्स" नामक एक नया तकनीकी पेपर लिखा गया था।

सार:
"मेमोरी सिस्टम सर्वर प्रोसेसर के लिए एक प्रमुख प्रदर्शन निर्धारक है। लगातार बढ़ते कोर काउंट और डेटासेट उच्च बैंडविड्थ और क्षमता के साथ-साथ मेमोरी सिस्टम से कम विलंबता की मांग करते हैं। बढ़ती मांगों को पूरा करने के लिए, DDR- पिछले दो दशकों में मेमोरी के लिए प्रमुख प्रोसेसर इंटरफ़ेस- ने हर पीढ़ी के साथ उच्च बैंडविड्थ की पेशकश की है। हालाँकि, क्योंकि प्रत्येक समानांतर DDR इंटरफ़ेस में बड़ी संख्या में ऑन-चिप पिन की आवश्यकता होती है, प्रोसेसर की मेमोरी बैंडविड्थ को अंततः इसके पिन-काउंट द्वारा नियंत्रित किया जाता है, जो एक दुर्लभ संसाधन है। सीमित बैंडविड्थ के साथ, कई मेमोरी अनुरोध आमतौर पर प्रत्येक मेमोरी चैनल के लिए संघर्ष करते हैं, जिसके परिणामस्वरूप महत्वपूर्ण कतार में देरी होती है जो अक्सर DRAM के सेवा समय को कम करती है और प्रदर्शन को कम करती है।

हम CoaXiaL प्रस्तुत करते हैं, एक सर्वर डिज़ाइन जो सभी DDR इंटरफेस को अधिक पिन-कुशल CXL इंटरफ़ेस के साथ प्रोसेसर में बदलकर मेमोरी बैंडविड्थ सीमाओं को पार कर जाता है। सीएक्सएल का व्यापक रूप से अपनाने और औद्योगिक गति इस तरह के संक्रमण को संभव बनाती है, डीडीआर की तुलना में प्रति पिन 4 × उच्च बैंडविड्थ की पेशकश एक मामूली विलंबता ओवरहेड पर करती है। हम प्रदर्शित करते हैं कि वर्कलोड की एक विस्तृत श्रृंखला के लिए, सीएक्सएल का लेटेंसी प्रीमियम इसकी उच्च बैंडविड्थ द्वारा ऑफसेट से अधिक है। जैसा कि CoaXiaL अधिक चैनलों में मेमोरी अनुरोधों को वितरित करता है, यह क्यूइंग देरी को काफी कम कर देता है और इस तरह मेमोरी एक्सेस लेटेंसी का औसत मूल्य और भिन्नता दोनों होता है। विभिन्न प्रकार के वर्कलोड के साथ हमारे मूल्यांकन से पता चलता है कि CoaXiaL औसतन 1.52× और 3× तक कई कोर थ्रूपुट-उन्मुख सर्वरों के प्रदर्शन में सुधार करता है।”

खोज तकनीकी कागज यहाँ। 2023 हो सकता है।

लेखक: अल्बर्ट चो, अनीश सक्सेना, मोइनुद्दीन कुरैशी, एलेक्जेंड्रोस डागलिस। आर्क्सिव: 2305.05033v1.
https://doi.org/10.48550/arXiv.2305.05033

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• स्रोत: https://semiengineering.com/server-design-with-pin-efficient-cxl-interface-georgia-tech/